Automated Reasoning for Bluespec Designs

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Esta página contém ferramentas para aplicar raciocínio automatizado aos designs de hardware bluespec SystemVerilog (BSV). Fornecemos código para importar desenhos de BSV no prover de teorema PVS e no verificador de modelos SAL.

história da versão

  • Versão files postado em 2011-04-04
    Várias correções e atualizações
  • Versão N/A postado em 2011-04-04

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